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【24h】

多結晶シリコン光導電素子の周波数応答

机译:多晶硅光电导元件的频率响应

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摘要

我々はCMOSプロセスとの融合性があり、低温プロセスで堆積·多層化が可能な多結晶シリコン(poly-Si)を用いた光導電素子を作製し、波長650nmにおける感度および周波数特性評価を行った。電極パターンはアォトリソグラフィによって形成し、リフトオフ法によりNiを蒸着した。Poly-Si膜はSiO_2基板上にCat-CVD法により1.2μm厚堆積させたアモルファスシリコン(a-Si)を窒素雰囲気中で600℃、100分間熱処理することにより得た。受光部は櫛型電極構造を形成しており、受光部面積は50×50μm~2、電極幅·電極間隔はそれぞれ2μmである。作製した素子の特性評価を行ったところ、波長650nmにおいて感度36mA/W、最大帯域30MHz@V_(bias)=30Vを得た。さらに、poly-Si膜をドライエッチングにより0.2μmまで薄膜化して、同様に素子の作製·特性評価を行った。薄膜化により感度0.8mA/Wと減少したが、最大帯域は200MHz@V_(bias)=30Vに向上した。
机译:我们使用与CMOS工艺兼容并可以在低温工艺中沉积和多层化的多晶硅(poly-Si)制造了一种光电导器件,并评估了650 nm波长下的灵敏度和频率特性。 ..通过自动光刻法形成电极图案,并通过剥离法沉积Ni。通过在氮气氛中通过Cat-CVD法在600℃下将沉积在SiO_2衬底上的1.2μm厚的非晶硅(a-Si)在600℃下热处理100分钟来获得多晶硅膜。受光部具有梳状电极结构,受光部的面积为50×50μm至2,电极宽度和电极间隔分别为2μm。当评估制成的器件的特性时,在650 nm的波长下获得了36 mA / W的灵敏度和30 MHz @ V_(bias)= 30 V的最大带宽。此外,通过干蚀刻将多晶硅膜减薄至0.2μm,并且制造该器件并且以相同的方式评价其特性。由于变薄,灵敏度降低到0.8mA / W,但最大频带提高到200MHz @ V_(bias)= 30V。

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