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机译:采用45 nm技术的7T SRAM单元的漏电流降低技术
CMOS; Gate leakage current; Sub threshold current; Voltage level switch; SRAM; Stand-by power;
机译:采用45 nm技术的7T SRAM单元的漏电流降低技术
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机译:使用SNM 0n 45nm技术分析7T SRAM单元以提高单元稳定性
机译:采用7NM FinFET技术的SRAM单元的漏电攻击恢复设计
机译:功耗优化的变化感知双阈值SRAM单元设计技术
机译:90nm和65nm技术在常规6TSRAM位细胞中温度和VDD对漏电流影响的分析