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具有内部高速缓存和/或内存访问预测的内存集线器

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摘要

一种计算机系统，包括用于将处理器(104)耦合到多个同步动态随机访问内存(“SDRAM”)设备的内存集线器(130)。内存集线器(130)包括耦合到处理器(104)的处理器接口(150)以及耦合到相应的SDRAM设备(140a-c)的多个内存接口(170a-c)。处理器接口(150)通过开关(160)耦合到内存接口(170a-c)。内存接口(170a-c)的每一个包括一个内存控制器(180)、一个高速缓存(184)和一个预测单元(190)。高速缓存(184)存储最近从相应的SDRAM设备(140a-c)读取的或者写入到相应的SDRAM设备(140a-c)的数据，使得其随后可以由处理器(104)以相当小的延迟读取。预测单元(190)基于以前被访问的地址，从可能的读取访问的地址预取数据。

著录项

公开/公告号CN100361095C

专利类型发明授权
公开/公告日2008-01-09

原文格式PDF
申请/专利权人米克伦技术公司;
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申请/专利号CN03818759.0
发明设计人约瑟夫·杰德洛;
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申请日2003-06-06
分类号G06F12/06(20060101);
代理机构72002 永新专利商标代理有限公司;
代理人王英
地址美国爱达荷
入库时间 2022-08-23 09:00:17

法律信息

法律状态公告日

法律状态信息

法律状态
2012-08-08

未缴年费专利权终止 IPC(主分类):G06F 12/06 授权公告日:20080109 终止日期:20110606 申请日:20030606

专利权的终止
2008-01-09

授权

授权
2005-11-23

实质审查的生效

实质审查的生效
2005-09-28

公开

公开

相似文献

专利
中文文献
外文文献

1. 具有内部高速缓存和/或内存访问预测的内存集线器 [P] . 中国专利： CN100361095C . 2008.01.09
2. 具有内部行高速缓存的内存集线器及访问方法 [P] . 中国专利： CN100334564C . 2007.08.29
3. Microprocessor simultaneously issues an access to an external cache over an external cache bus and to an internal cache, cancels the external cache access on an internal cache hit, and reissues the access over a main memory bus on an external cache miss [P] . 美国专利： US5345576A . 1994-09-06

机译：微处理器同时通过外部高速缓存总线发布对内部高速缓存的访问以及对内部高速缓存的访问，在内部高速缓存命中时取消对外部高速缓存的访问，并在外部高速缓存未命中时通过主内存总线重新发出访问
4. MEMORY HUB WITH INTERNAL CACHE AND/OR MEMORY ACCESS PREDICTION [P] . 美国专利： US2012239885A1 . 2012-09-20

机译：具有内部缓存和/或内存访问预测的内存集线器
5. MEMORY HUB WITH INTERNAL CACHE AND/OR MEMORY ACCESS PREDICTION [P] . 美国专利： US2011219196A1 . 2011-09-08

机译：具有内部缓存和/或内存访问预测的内存集线器