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数字滤波电路和数字滤波控制方法

摘要

[目标]提供一种能够在频域中进行诸如重叠FDE方法的滤波处理的能够减小电路规模和功耗的数字滤波电路和数字滤波控制方法。[解决方案]根据本发明的数字滤波电路包括:重叠附加装置,用于给出在该块与前一个块之间的M个数据(M是正整数)的重叠;FFT处理装置,用于通过执行FFT处理变换生成的块;滤波计算装置,用于对变换的块执行滤波处理;IFFT装置,用于通过IFFT处理变换执行了滤波处理的块;重叠去除装置,用于从变换的块的两端去除M个数据单位;以及时钟生成装置,用于基于M的值设定滤波处理时钟信号的频率,其中滤波处理时钟信号驱动重叠附加装置的数据输出单元、FFT装置、滤波计算装置、IFFT装置以及重叠去除装置的输入单元。

著录项

  • 公开/公告号CN103270697A

    专利类型发明专利

  • 公开/公告日2013-08-28

    原文格式PDF

  • 申请/专利权人 日本电气株式会社;

    申请/专利号CN201180062164.1

  • 发明设计人 柴山充文;

    申请日2011-08-18

  • 分类号H03H17/02(20060101);

  • 代理机构11219 中原信达知识产权代理有限责任公司;

  • 代理人孙志湧;穆德骏

  • 地址 日本东京

  • 入库时间 2024-02-19 20:16:50

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2016-10-19

    专利权的视为放弃 IPC(主分类):H03H17/02 放弃生效日:20161019 申请日:20110818

    专利权的视为放弃

  • 2013-09-25

    实质审查的生效 IPC(主分类):H03H17/02 申请日:20110818

    实质审查的生效

  • 2013-08-28

    公开

    公开

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