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周冠宇;
南京航空航天大学;
现场可编程门阵列; MobileNet; 并行计算; 加速;
机译:具有块浮点算法的基于FPGA的高性能CNN加速器
机译:具有数据压缩机制的基于FPGA的高性能排序加速器
机译:基于FPGA的硬件加速器,用于高性能数据流处理
机译:基于FPGA的MobileNet卷积神经网络加速器设计。
机译:一种基于FPGA的高性能3类HECC的实现。
机译:EDSSA:基于OpenCL的FPGA平台上的编码器 - 解码器语义分段网络加速器
机译:基于高性能的基于FPGA的BWA-MEM加速器
机译:IFmIF(国际聚变材料辐照设施),一种基于加速器的融合组件辐照测试中子源:材料测试能力。
机译:通过组合基于fpgas的数字加速器和基于对象的界面来设计通用高性能计算机应用程序的方法
机译:DUT FPGA一种测试架构,具有基于FPGA的硬件加速器模块,可独立测试多个器件
机译:基于FPGA的高性能计算加速器平台
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