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基于FPGA先进加密算法(AES)的并行实现

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摘要

讨论了AES算法的并行特性,提出在明文分组和密钥分组都是128位的情况下,采用内部流水结构和并行密钥处理策略,在现场可编程门阵列上的一种并行的快速ASIC实现方案,并对整个系统的关键性能指标进行了讨论.

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来源
《交通信息与安全》 |2002年第6期|20-22|共3页
作者
佟玉伟; 陆浪如; 李明; 柯善学;
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作者单位

解放军信息工程大学,郑州,450002;

解放军信息工程大学,郑州,450002;

解放军信息工程大学,郑州,450002;

解放军信息工程大学,郑州,450002;

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原文格式 PDF
正文语种 chi
中图分类计算技术、计算机技术;
关键词
密钥扩展; 流水线; 可编程逻辑阵列;

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