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范好好; 何军;
中国计算机学会;
整数除法器; 迭代过程; 数据负载; 迭代周期延迟;
机译:基于COMPASS单元库的Radix-8 / 4/2 64b / 32b整数除法器的设计与分析
机译:使用COMPASS单元库设计基数为8/4/2 64b / 32b的整数除法器并进行分析
机译:基于Flying-Adder分数除法器的整数N PLL:第二代FAPLL作为片上频率发生器,用于SoC
机译:牛顿拉夫森除法器的一种改进的倒数逼近算法
机译:一种新颖的四象限CMOS模拟乘法器/除法器。
机译:通过函数微积分逼近双线性乘法器
机译:在整数除法器附近
机译:一种利用自对偶正规基础设计有限域乘法器的算法
机译:低延迟整数除法器以及与浮点除法器和方法的集成
机译:带有阶梯式除法器的级联电路和可调节的电压除法器的除法器以及用于调节相同除法器的控制电路
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