虚通道
虚通道的相关文献在1995年到2022年内共计119篇,主要集中在自动化技术、计算机技术、无线电电子学、电信技术、教育
等领域,其中期刊论文75篇、会议论文10篇、专利文献79552篇;相关期刊50种,包括电子学报、通信世界、通信技术等;
相关会议10种,包括第二十届计算机工程与工艺年会暨第六届微处理器技术论坛 、2011年全国高性能计算学术年会(HPC china2011)、第十三届全国容错计算学术会议等;虚通道的相关文献由239位作者贡献,包括刘燕、杨晓东、严忻恺等。
虚通道—发文量
专利文献>
论文:79552篇
占比:99.89%
总计:79637篇
虚通道
-研究学者
- 刘燕
- 杨晓东
- 严忻恺
- 孙利民
- 席裕庚
- 曲润涛
- 杨萱
- 严晓浪
- 凌翔
- 吴志兵
- 周升
- 朱道山
- 沈慧
- 潘赟
- 罗杰
- 陈忠平
- 颜晓峰
- B·佩德森
- 冉峰
- 冯刚
- 冯树
- 刘军民
- 刘泽民
- 刘鹏
- 叶宏
- 吴树明
- 吴铁彬
- 周烨
- 唐勇
- 喻文芳
- 夏鞑
- 姚磊
- 姜玉琴
- 孙红辉
- 宋宇鲲
- 尹勇生
- 崇云锋
- 张多利
- 张昆
- 张治中
- 张海林
- 张清波
- 徐海鹏
- 方科
- 施晶晶
- 曾华燊
- 曾烈光
- 李勇
- 李向阳
- 李本娟
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欧阳一鸣;
张鹏;
王奇;
安鑫;
梁华国
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摘要:
WiNoC(Wireless Network-on-Chip)中的无线路由器面临着比传统片上路由器更加严峻的拥塞问题,平衡有线/无线链路负载是当前无线片上网络的研究热点之一.为此本文提出并设计了一种基于优先级的交叉开关仲裁方案PbSA(Priority based Switch allocator),其将优先级更高的无线数据包优先路由至无线路由器;结合PbSA提出了拥塞感知的路由算法CARA(Congestion-Aware Routing Algorithm),该算法有效平衡有线/无线链路负载且避免死锁,提高了数据包在网络中的路由效率.此外,本文还提出了新颖的虚通道划分方法,它不仅减少了实现PbSA的硬件复杂度,而且缓解了无线路由器发生拥塞时对整个网络的影响.实验表明,虽然本文的方案引入了较小的面积和功耗开销,但是具有良好的流量自适应特性,从而在低注入率或高注入率的情况下较好的提升了网络性能.
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吴姣;
戴小氐;
崔西宁;
张亦姝
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摘要:
针对综合化航电对机载网络通信提出的新要求,通过研究ASAAC中关于软件和通信的相关技术,按照机载应用的使用需求,设计并实现了一种虚通道通信技术,将网络介质、传输协议、操作系统等与应用任务解耦,在满足实时性和安全性的同时,提高了通信的透明性,为系统管理和应用任务提供了统一的通信平台,并基于FC网络进行了测试与验证.在某飞机的航电系统中得到了应用,功能和性能指标满足系统设计需求.
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唐宇
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摘要:
现代机载系统的综合化是将多个独立功能设备作为一个整体进行设计,在模块级进行高度综合集成,而串行RapidIO总线为核心的高性能交换网络是有效解决模块级集成互联的手段之一.作者所在团队在国外RapidIO总线标准的基础上结合工程实践,提炼升华为机载RapidIO总线标准.本文分析了该标准的构成和层次,提出了指导性的设计原则.
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朱道山
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摘要:
FPGA is widely used in avionics system,the method using JTAG to download the program is limited by the environment and equipment,it is inefficient,lack of flexibility and difficult to meet the needs of engineering demands.In this paper,a scheme to realize remote update of FPGA program is proposed.The scheme uses the RapidIO bus to build an online update real-time communication link in a heterogeneous way.The image file is transmitted from SRIO switch network to the FPGA node through the Ethernet,and then is written into the FLASH configuration space to achieve the remote update of FPGA program.After the test,the correctness and feasibility of the design is verified.The speed of FPGA program update is improved effectively.%现场可编程逻辑门阵列(FPGA)在航电系统领域广泛应用,但是采用JTAG方式更新FPGA程序,效率低下,易受设备环境限制而缺乏灵活性,已经难以满足工程应用的需求.提出了一种实现FPGA程序远程更新的方案,该方案采用RapidIO总线,以软件异构的方式,构建在线更新实时通信链路.通过以太网下发镜像升级文件,经SRIO交换网络传送至FPGA节点,写入FLASH配置空间,实现FPGA程序的远程更新.经过测试,验证了设计的正确性和可行性,并有效地提高了FPGA程序更新的速度.
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刘鹏;
徐海鹏;
崇云锋;
赵倩情
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摘要:
随着芯片复杂度的不断增大,设计一个高效的片上网络容错路由算法面临着巨大的挑战;由于芯片面积开销的限制,拥有低面积开销的无虚通道片上网络路由器受到学术界的广泛关注;但目前对无虚通道片上网络容错路由算法的研究却停留在容错性能上,而忽略了容错路由算法的路由路径过于单一所造成的负载不均、数据包平均延迟较大等问题;文章在借鉴已有的奇偶转向容错路由算法的基础上,对算法的故障模型和故障绕行策略进行优化,并在算法中融入负载均衡策略,以形成新的容错算法缓解上述问题;在9x9的2Dmesh网络中对新提出的算法和参考算法的仿真结果表明:与参考算法相比,新算法在降低数据延迟和吞吐量方面有着明显的优势,在最优情况下能减少8.92%数据延迟和增加10.46%的吞吐量.%As structure of chip is becoming more complex,an efficient routing algorithm designed for Network on Chip has became increasingly challenging.Currently,the research of fault-tolerant routing algorithm without virtual channels mainly focus on routing around fault,but neglects issues of load-balancing and latency caused by communication hotspot and single path between source and destination.To address the problems,a fault-tolerant routing algorithm based on Odd-Even turn rules with load-balancing strategy is proposed based on existing OE fault-tolerant strategy.The novel algorithm extend Odd-Even fault model and Odd-Even fault-tolerant strategy to enhance capacity of fault-tolerant and also fuse a load-balance strategy to relieve the issues.The simulation results demonstrate that the proposed algorithm outperforms in average package latency and throughout compared to reference algorithms in the 9x9 2D mesh NoC.In the best case,it reduces 8.92% average delay and increase 10.46% throughout.
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李彬;
董德尊;
吴际;
夏军
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摘要:
片上网络(network‐on‐chip ,NoC)消耗的功耗在整个芯片中所占比例不断增大,并且随着芯片工艺精度的提升和工作电压的不断降低,静态功耗占片上网络总功耗的比例也越来越大.当前芯片设计者致力于将未被使用的核设置为休眠状态来降低功耗.然而,即便是最前沿的芯片设计,当核休眠时与它连接的路由器都是保持在正常状态来进行报文传输.而与休眠核相连的片上网络路由器由于没有注入和吸收的报文,负载相对较低.在SMART (single‐cycle multi‐hop asynchronous repeated traversal)片上网络中,报文能够单周期从源路由器到目标路由器.基于单周期多跳旁路(SM ART )技术,提出一种关闭低负载路由器虚通道的策略P‐SM ART ,以在不影响网络性能的情况下节省片上网络功耗.实验结果表明:相对于SMART 技术,P‐SMART的性能损失不超过2%,而功耗节省13.4%.%As the number of on‐chip cores in chip multiprocessors (CMPs) increase ,size of network‐on‐chips (NoCs) and network latency increase .NoCs consume an increasing fraction of the chip power as technology and voltage continue to scale down ,and static power consumes a larger fraction of the total power .Currently ,processor designers strive to send under‐utilized cores into deep sleep states in order to improve overall energy efficiency .However ,even in state‐of‐the‐art CMP designs ,when a core going to sleep the router attached to it remains active in order to continue packet forwarding .The router attached to a sleeping core has low traffic load ,due to no packets to or from sleeping core .An on‐chip network called SMART (single‐cycle multi‐hop asynchronous repeated traversal) that aims to present a single‐cycle data‐path all the way from the source to the destination .This paper ,we propose reducing the VC(virtual channel) of router that is attached to sleeping core ,based on SMART NoC , reducing power consumption and bringing little performance penalty .We evaluate our network using synthetic traffics .Our evaluation results show that VC power gating increases network latency less than 2% when the workload is low ,and compared with no bypass path network ,the power is reduced about 13 .4% .
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李娇;
刘鹏;
王良华;
崇云锋;
徐海鹏
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摘要:
在借鉴已有的容错路由算法基础上,对故障节点进行扩展,解除部分节点转向限制、实施一定的均衡策略,缓解了上述问题.在9×9的2D mesh网络中的仿真结果表明:与未改进的算法相比,算法在降低数据延迟和过热节点数量等方面有着明显的优势,在最优情况下能降低12.7%的数据延迟和减少18.5%的过热节点.
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潘灵
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摘要:
针对RapidIO总线互联系统中网络节点间高效端对端通信功能的缺失,实现了基于消息机制的RapidIO通信中间件,以虚通道的方式为应用提供数据传输功能.虚通道采用HOST节点集中控制的管理方式,易于实现系统功能的迁移与重构.实物环境中的带宽、时延测试表明,RapidIO通信中间件具有很高的传输效率.
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薛文良;
马胜;
许邦建
- 《第二十届计算机工程与工艺年会暨第六届微处理器技术论坛》
| 2016年
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摘要:
GPGPU作为一种高度并行的众核协处理器,对提升计算性能具有重要意义.本文分析了GPGPU片上网络的通信特性,发现网络中请求报文流量和回复报文流量的不对称性对片上系统性能有较大的影响.本文在静态虚通道划分机制的基础上,提出一种自适应动态虚通道划分机制.自适应动态虚通道划分机制可以根据网络状态对虚通道和带宽资源进行动态可重构分配,与静态虚通道划分机制相比,自适应动态虚通道划分机制在较低开销的情况下,平均提高了10.5%的性能.
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石世领;
刘炎华;
孙玲
- 《2016年上海市研究生学术论坛——电子科学与技术》
| 2016年
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摘要:
NoC作为SoC的下一代主流技术已经得到了快速的发展,然而设计一个高性能、低延时、资源占用少的NoC依然是个难点.本文提出了一种两个流水线级的NoC路由器架构,通过采用超前路由计算、以非推测性手段融合虚通道分配阶段和交叉开关分配阶段,减少传统路由器的流水阶段,从而改善了路由器的通信时延,为实现低延时的NoC设计提供了参考.
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马驰远;
衣晓飞;
邢座程;
陈书明
- 《第十一届计算机工程与工艺全国学术年会》
| 2007年
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摘要:
本文提出一种支持流数据传输的互连网络控制器的设计。该设计应用于FT64流处理器上,使得多个流处理器能够通过高性能网络进行数据传输以便进行并行流数据运算。该设计采用二维环绕网,使用虚通道避免死锁,支持多个流的数据同时传输。投片后的测试结果表明,该设计功能正确,核心频率为500MHz,链路时钟频率为400MHz,满足设计要求。
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路文斌;
姜海波
- 《第二十二届计算机工程与工艺年会暨第八届微处理器技术论坛》
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摘要:
基于高阶路由器构建大规模互连网络已经成为高性能计算领域的重要研究方向,高阶路由器中的仲裁策略应满足各个虚通道对目的流量比例以及优先级的需求.结合传统的FP、RR、LOTTERY仲裁策略,提出两种基于双层嵌套的仲裁策略——RL策略和RP策略.在RTL级的4×4高阶路由器上对设计的策略同传统策略进行对比,并利用DC综合工具对仲裁策略进行实现分析.结果表明,本文设计的两种仲裁策略在略为提升物理代价前提下,提高了对目的流量比例以及优先级的满足程度,具有应用价值.
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