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Clock-pulse train monitoring circuit - compares input clock pulse train pattern with stored control train pattern to detect differences

机译:时钟脉冲序列监视电路-将输入时钟脉冲序列模式与存储的控制序列模式进行比较以检测差异

摘要

The monitoring circuit has a single test line (b) connected to the clock pulse output lines (A1, An), in order to detect faults in the time sequence of the pulse trains appearing on these lines. The pulse sequence on the test line is compared (Vg) with the time characteristics of the control signals of fixed format used for originally generating these pulses. If there is a difference in a characteristic (time at which a pulse or pulse interval occurs, a fault signal is transmitted (GD, GA, GZ). The system enables monitoring of clock pulse train on a single line, one which the actual pulse trains are fed to the components.
机译:监视电路具有连接到时钟脉冲输出线(A1,An)的一条测试线(b),以便检测出现在这些线上的脉冲序列的时间顺序中的故障。将测试线上的脉冲序列(Vg)与最初用于生成这些脉冲的固定格式控制信号的时间特性进行比较。如果特性存在差异(出现脉冲或脉冲间隔的时间),则会发送故障信号(GD,GA,GZ),该系统可以在单条线上监视时钟脉冲序列,而实际的脉冲是火车被送入组件。

著录项

  • 公开/公告号DE2842350A1

    专利类型

  • 公开/公告日1980-04-17

    原文格式PDF

  • 申请/专利权人 SIEMENS AG;

    申请/专利号DE19782842350

  • 发明设计人 DIETLRUDOLF;EISLENGELBERT;

    申请日1978-09-28

  • 分类号H03K5/18;H04Q1/22;

  • 国家 DE

  • 入库时间 2022-08-22 17:35:18

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