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Method of fabricating semiconductor structure, by formulating first and/or second substrate layer to exhibit Coefficient of Thermal Expansion (CTE) closely matching CTE of first and/or additional semiconductor layer

机译:通过配制第一和/或第二衬底层以表现出与第一和/或附加半导体层的CTE紧密匹配的热膨胀系数(CTE)来制造半导体结构的方法

摘要

The method involves forming a first substrate layer over a surface of a first semiconductor layer, and thermally spraying a second substrate layer (310) on a side of the first substrate layer opposite the first semiconductor layer. At least one additional semiconductor layer is epitaxially grown over the first semiconductor layer on a side opposite the first substrate layer. The first and/or second substrate layer is formulated to exhibit a CTE closely matching a CTE of at least one of the first semiconductor layer and the additional semiconductor layer. An independent claim is also included for a semiconductor structure.
机译:该方法包括在第一半导体层的表面上方形成第一衬底层,以及在第一衬底层的与第一半导体层相对的一侧上热喷涂第二衬底层(310)。在与第一衬底层相对的一侧上的第一半导体层之上外延生长至少一个附加的半导体层。配制第一和/或第二衬底层以表现出与第一半导体层和附加半导体层中的至少一个的CTE紧密匹配的CTE。对于半导体结构也包括独立权利要求。

著录项

  • 公开/公告号FR2985853A1

    专利类型

  • 公开/公告日2013-07-19

    原文格式PDF

  • 申请/专利权人 SOITEC;

    申请/专利号FR20120050388

  • 发明设计人 WERKHOVEN CHRISTIAAN J.;ARENA CHANTAL;

    申请日2012-01-16

  • 分类号H01L21/20;B32B7/02;H01L21/263;H01L21/71;H01L23/12;

  • 国家 FR

  • 入库时间 2022-08-21 16:20:57

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