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Failure tree system reliability analysis system, failure tree system reliability analysis method and program

机译:故障树系统可靠性分析系统,故障树系统可靠性分析方法和程序

摘要

The present invention is a failure tree system reliability analysis system, wherein a logical sum k / n gate having an OR gate as an input is changed to a disjoint logical product k / m gate (m ≦ n) not having the OR gate as an input. It is a fault tree system reliability analysis system having k / n gate dividing means for dividing.
机译:本发明是一种故障树系统可靠性分析系统,其中将具有或门作为输入的逻辑和k / n门改变为不具有或门作为逻辑门的不相交逻辑乘积k / m门(m≤n)。输入。它是一种故障树系统可靠性分析系统,具有用于划分的k / n门划分装置。

著录项

  • 公开/公告号JPWO2012115095A1

    专利类型

  • 公开/公告日2014-07-07

    原文格式PDF

  • 申请/专利权人 日本電気株式会社;

    申请/专利号JP20130501066

  • 发明设计人 向 剣文;

    申请日2012-02-21

  • 分类号G06F11/22;

  • 国家 JP

  • 入库时间 2022-08-21 16:11:41

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