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PCI快速多根I/O虚拟化环境中的低延迟优先排序

摘要

一种用于在快速PCI(PCIe)多根I/O虚拟化(MR‑IOV)环境中使用的低延迟优先排序检查的装置和方法。优先排序检查架构帮助允许端口与PCIe MR‑IOV排序规则兼容。发布信息阵列反映发布事务队列,存储用于发布事务队列中存储的对应发布事务条目的优先顺序指示符和虚拟层级(VH)标签信息。选择器周期性地(如每个周期)查询发布信息阵列,以确定在它们各自队列的输出的非发布/完成事务在发布队列的某个地方是否具有相同VH的任何优先发布事务。

著录项

  • 公开/公告号CN103392175B

    专利类型发明专利

  • 公开/公告日2016-08-10

    原文格式PDF

  • 申请/专利权人 国际商业机器公司;

    申请/专利号CN201280010315.3

  • 发明设计人 L.格拉斯;O.M.谢奥里;

    申请日2012-01-25

  • 分类号G06F13/00(20060101);

  • 代理机构11105 北京市柳沈律师事务所;

  • 代理人张贵东

  • 地址 美国纽约阿芒克

  • 入库时间 2022-08-23 09:43:53

法律信息

  • 法律状态公告日

    法律状态信息

    法律状态

  • 2016-08-10

    授权

    授权

  • 2013-12-04

    实质审查的生效 IPC(主分类):G06F 13/00 申请日:20120125

    实质审查的生效

  • 2013-11-13

    公开

    公开

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