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机译:同期式設計から変換されたQDI回路のテスト生成法
内田行紀; 村田絵理; 大竹哲史中島康彦;
奈良先端科学技術大学院大学;
大分大学;
非同期回路; Quasi-Delay-Insensitive; テスト生成; テスト容易化設計; 同期-非同期変換;
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