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International Symposium on Multiple-Valued Logic
International Symposium on Multiple-Valued Logic
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1.
Quantum communication complexity: a survey
机译:
量子通信复杂性:调查
作者:
Brassard G.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
quantum communication;
quantum entanglement;
communication complexity;
quantum entanglement;
quantum information processing;
spooky communication;
pseudo-telepathy;
quantum communication complexity;
2.
Non-deterministic Matrices
机译:
非确定性矩阵
作者:
Arnon Avron
;
Iddo Lev
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
3.
On the Minimization of Multiple-Valued Input Binary-Valued Output Functions
机译:
关于多值输入二进制值输出函数的最小化
作者:
Hafiz Md. Hasan Babu
;
Moinul Islam Zaber
;
Md. Rafiqul Islam
;
Md. Mazder Rahman
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
Multiple-Valued Input Two-Valued Output Functions;
Prime Implicant;
Logic Minimization;
Sum-of-Products (SOPs);
4.
Automata over MV-algebras many-valued logic
机译:
MV-Algebras的自动机许多值逻辑
作者:
Gerla B.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
automata theory;
multivalued logic;
fuzzy logic;
algebra;
formal languages;
fuzzy automata;
Lukasiewicz many-valued logic;
W-algebras;
semiring reducts;
supremum operation;
Lukasiewicz conjunction;
infimum operation;
Lukasiewicz disjunction;
isomorphism;
many-valued automata;
many-valued formal languages;
5.
A Systolic Parallel Multiplier over GF(3{sup}m) Using Neuron-MOS DLC
机译:
使用Neuron-MOS DLC通过GF(3 {SUP} M)的收缩期并行乘法器
作者:
Byoung Hee Yoon
;
Sung Il Han
;
Young-Hee Choi
;
Jong-Hak Hwang
;
Hyeon-Kyeong Seong
;
Heung Soo Kim
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
6.
Optimizing the Defuzzifier Timing for the Fuzzy Control of a Servodrive
机译:
优化Defuzzify对伺服驱动模糊控制的定时
作者:
Dan Mihai
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
7.
Uniform description of calculi for all t-norm logics
机译:
所有T-NOM逻辑的Calculi的统一描述
作者:
Stefano Aguzzoli
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
8.
A study of multiple-valued magnetoresistive RAM (MRAM) using binary MTJ devices
机译:
使用二元MTJ器件研究多值磁阻RAM(MRAM)
作者:
Kimura H.
;
Pagiamtzis K.
;
Sheikholeslami A.
;
Hanyu T.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
magnetoresistive devices;
SRAM chips;
multivalued logic circuits;
tunnelling magnetoresistance;
multiple-valued MRAM;
binary MTJ devices;
four-valued magnetoresistive RAM;
magnetic tunnel junction devices;
single access transistor;
MRAM storage cells;
series connected cells;
parallel connected cells;
9.
On Universality of General Reversible Multiple-Valued Logic Gates
机译:
关于一般可逆多价逻辑门的普遍性
作者:
Pawel Kerntopf
;
Marek A. Perkowski
;
Mozammel H. A. Khan
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
10.
Evolutionary strategy for learning multiple-valued logic functions
机译:
学习多价逻辑功能的进化策略
作者:
Ngom A.
;
Simovici D.A.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic;
feedforward neural nets;
multilayer perceptrons;
evolutionary computation;
minimal multilayer feedforward neural networks;
multiple-valued multiple-threshold perceptrons;
evolutionary strategy;
multiple-valued logic function learning;
inter-parallel hyperplane strips;
hidden units;
partitioning method;
11.
On the minimization of average path lengths for heterogeneous MDDs multi-valued decision diagrams
机译:
关于异构MDDS的平均路径长度的最小化多值决策图
作者:
Nagayama S.
;
Sasao T.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
decision diagrams;
logic partitioning;
minimisation;
multivalued logic;
reduced order systems;
average path length minimization;
heterogeneous MDD;
heterogeneous multiple-valued decision diagrams;
binary logic function;
binary variable partitioning;
logic function representation;
reduced ordered binary decision diagrams;
ROBDD;
12.
Derivatives for Multiple-Valued Functions Induced by Galois Field and Reed-Muller-Fourier Expressions
机译:
Galois Field和Reed-Muller-Fourier表达式引起的多价函数的衍生物
作者:
Radomir S. Stankovic
;
Claudio Moraga
;
Jaakko Astola
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
13.
Multiple-Valued Source-Coupled Logic VLSI Based on Adaptive Threshold Control and Its Applications
机译:
基于自适应阈值控制及其应用的多值源耦合逻辑VLSI
作者:
Haque Mohammad Muniml
;
Michitaka Kameyama
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
14.
Intra-chip address-presetting data-transfer scheme using four-valued encoding
机译:
使用四维编码的芯片内地址预设数据传输方案
作者:
Mochizuki A.
;
Takeuchi T.
;
Hanyu T.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
CMOS logic circuits;
system buses;
integrated circuit interconnections;
multivalued logic circuits;
VLSI;
current-mode circuits;
low-power electronics;
intra-chip address-presetting data-transfer scheme;
four-valued encoding;
common-bus architecture;
high-speed data transfer;
VLSI chip modules;
source/destination module start addresses;
maximum bus width communication;
multiple-valued data encoding;
current-mode circuit;
multilevel signal detectors;
power dissipation reduction;
CMOS;
64 bit;
0.18 micron;
15.
Automata over MV-algebras
机译:
MV-Algebras的自动机
作者:
Brunella Gerla
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
16.
Monoids whose centralizer is the least clone
机译:
扶正器是最少的克隆
作者:
Machida H.
;
Rosenberg N.G.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
group theory;
least clone;
monoids;
centralizer;
unary functions;
multiple-variable functions;
function commutation;
Zadori's theorem;
17.
Hard vs. soft: the central question of pre-fabricated silicon
机译:
硬与软:预先制造的硅的核心问题
作者:
Rose J.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
field programmable gate arrays;
circuit layout CAD;
combinational circuits;
hardware-software codesign;
prefabricated silicon;
prefabricated programmable devices;
FPGA;
silicon implementation medium;
CAD;
circuit enhancement;
hard dedicated circuit structures;
regular soft fabric;
algorithms;
combinational logic elements;
18.
A Single-Electron-Transistor Logic Gate Family and Its Application - Part I: Basic Components for Binary, Multiple-Valued and Mixed-Mode Logic
机译:
单电子晶体管逻辑门系列及其应用 - 第一部分:二进制,多值和混合模式逻辑的基本组件
作者:
Katsuhiko Degawa
;
Takafumi Aoki
;
Tatsuo Higuchi
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
19.
Three Dimensional Multiple Valued Circuits Design Based on Single-Electron Logic
机译:
基于单电子逻辑的三维多值电路设计
作者:
S. N. Yanushkevich
;
V. P. Shmerko
;
L. Guy
;
D. C. Lu
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
20.
A Graph-Theoretical Approach to Boolean Interpolation of Non-Boolean Functions
机译:
非布尔函数布尔插值的图形理论方法
作者:
Sergiu Rudeanu
;
Dan A. Simovici
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
21.
Characterization theorem of lattice implication algebras
机译:
晶格蕴涵代数的特征定理
作者:
Kondo M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
algebra;
Boolean algebra;
lattice implication algebras;
bounded commutative BCK algebras;
algebra class;
MV-algebras;
Wajsberg algebras;
22.
Characterization theorem of lattice implication algebras
机译:
晶格蕴涵代数的特征定理
作者:
Michiro KONDO
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
23.
Fast Optimization of Fixed-Polarity Reed-Muller Expansions over GF(5)
机译:
通过GF(5)的固定极性簧片搭接的快速优化
作者:
Bogdan J. Falkowski
;
Cicilia C. Lozano
;
Susanto Rahardja
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
24.
A method to evaluate logic functions in the presence of unknown inputs using LUT cascades
机译:
一种使用LUT级联在存在未知输入中的逻辑功能的方法
作者:
Iguchi Y.
;
Sasao T.
;
Matsuura M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic simulation;
logic design;
ternary logic;
table lookup;
unknown input logic function evaluation;
LUT cascades;
logic simulation;
two-valued logic functions;
regular ternary logic functions;
look-up table cascades;
double-rail logic representations;
25.
Algorithms for Taylor expansion diagrams IC design/verification applications
机译:
泰勒展开图的算法IC设计/验证应用
作者:
Fey G.
;
Drechsler R.
;
Ciesielski M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
directed graphs;
Boolean functions;
logic design;
computational complexity;
Boolean functions;
directed acyclic graph;
Taylor expansion diagram algorithms;
IC size problems;
IC synthesis;
IC verification;
TED data structure;
high level information;
function representation;
TED operations complexity;
TED optimization;
26.
Algebraic properties of totally irreducible elements of clone lattices
机译:
克隆格子完全不可缩续的元素的代数特性
作者:
Pogosyan G.R.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
algebra;
clone lattice algebraic properties;
clone lattice totally irreducible elements;
join-irreducible elements;
meet-irreducible elements;
algebraic lattices;
k-element universe;
countable clone set;
countable descending clone chains;
27.
Edge-valued decision diagrams for multiple-valued functions
机译:
用于多值函数的边缘值决策图
作者:
Stankovic R.S.
;
Astola J.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic;
decision diagrams;
attribute grammars;
edge-valued decision diagrams;
decision diagram attributed edges;
edge-valued diagrams;
multiple-valued logic functions;
additive edge attributes;
multiplicative edge attributes;
quaternary functions;
28.
Design of quaternary logic gate using double pass-transistor logic with neuron MOS down literal circuit
机译:
使用双通晶体管逻辑与Neuron MOD逻辑电路设计四季逻辑门
作者:
Soo Jin Park
;
Byoung Hee Yoon
;
Kwang Sub Yoon
;
Heung Soo Kim
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic gates;
multivalued logic circuits;
threshold logic;
CMOS logic circuits;
QMIN/QNMIN logic gates;
QMAX/QNMAX logic gates;
quaternary logic gate;
double pass-transistor logic;
neuron MOS down literal circuit;
multiply-valued logic;
MVL pass gate;
quaternary MIN/negated MIN gate;
quatemary MAX/negated MAX gate;
DPL;
vMOS threshold gate;
quaternary truncated sum gate;
quaternary truncated difference gate;
DLC;
multiple threshold voltages;
CMOS;
0.35 micron;
3 V;
29.
The interface between P and NP in signed CNF formulas
机译:
符号CNF公式中P和NP之间的界面
作者:
Ansotegui C.
;
Bejar R.
;
Cabiscol A.
;
Manya F.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
computability;
communicating sequential processes;
computational complexity;
polynomials;
combinatorial mathematics;
SAT solvers;
CSP formalisms;
constraint satisfaction formalisms;
combinatorial problems;
propositional satisfiability;
signed-SAT;
signed CNF formula P/NP interface;
NP-complete satisfiability problems;
many-valued satisfiability problems;
Mono+pPartiallySigned-2SAT;
Regular+pSigned-2SAT;
polynomial problems;
problem phase transition behavior;
30.
Iterative-based Minimization of Unary 4-valued Functions for Current-mode CMOS Realization
机译:
基于迭代的电流模式CMOS实现最小化Unary 4值函数
作者:
Mostafa Abd-El-Barr
;
Louai Al-Awami
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
31.
Evolutionary Strategy for Learning Multiple-Valued Logic Functions
机译:
学习多价逻辑功能的进化策略
作者:
Alioune Ngom
;
Dan A. Simovici
;
Ivan Stojmenovic
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
Multiple-valued logic;
Multiple-threshold perceptron;
Evolution strategy;
Neural network;
Partitioning method;
Constructive algorithm;
32.
On the Minimization of Average Path Lengths for Heterogeneous MDDs
机译:
关于异构MDDS平均路径长度的最小化
作者:
Shinobu NAGAYAMA
;
Tsutomu SASAO
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
33.
Uniform description of calculi for all t-norm logics
机译:
所有T-NOM逻辑的Calculi的统一描述
作者:
Aguzzoli S.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
formal logic;
calculus;
theorem proving;
algebra;
proof trees;
binary operations;
t-norm logic calculi;
standard algebra logic;
continuous t-norm residuum;
canonical t-algebra;
sets-as-signs many-valued tableau systems;
finite-valued reduction techniques;
co-NP calculi;
34.
A novel D-latch in multiple-valued semi-floating-gate recharged logic
机译:
多值半浮栅充电逻辑中的一种新型D-Latch
作者:
Mirmotahari O.
;
Berg Y.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic circuits;
flip-flops;
multiple-valued logic;
SFG D-latch;
semi-floating-gate recharged logic;
CUP process;
0.6 micron;
35.
Reduction of sizes of multi-valued decision diagrams by copy properties
机译:
通过复制属性降低多价决策图的大小
作者:
Jankovic D.
;
Stankovic R.S.
;
Drechsler R.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
decision diagrams;
multivalued logic;
Walsh functions;
binary codes;
multiple-valued decision diagram size reduction;
copy decision diagrams;
CDD;
multiple-terminal binary decision diagrams;
MTBDD;
discrete function copy properties;
Walsh functions;
Reed-Muller functions;
binary codes;
copy MDD;
CMDD;
36.
Ultra-fine-grain field-programmable VLSI using multiple-valued source-coupled logic
机译:
使用多值源耦合逻辑的超细晶粒现场可编程VLSI
作者:
Munirul H.M.
;
Kameyama M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
programmable logic arrays;
VLSI;
multivalued logic circuits;
pipeline processing;
reconfigurable architectures;
current-mode logic;
ultra-fine-grain field-programmable VLSI;
multiple-valued source-coupled logic;
MV-FPVLSI;
special-purpose processors;
interconnection block complexity reduction;
bit-serial pipeline architecture;
program-counter-less processor architecture;
direct allocation;
2D mesh array cells;
data transmission delay;
reconfigurable cells;
logic function;
memory function;
counter function;
current-mode operation;
37.
Controlling Uncertainty in Discretization of Continuous Data
机译:
控制连续数据的离散化的不确定性
作者:
Denis V. Popel
;
Elena I. Popel
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
Continuous data;
Decision diagrams;
Discretization;
Information theory;
Knowledge representation;
Multiple-valued logic;
38.
Resolution-based decision procedures for the positive theory of some finitely generated varieties of algebras
机译:
基于解决的决议的决策程序,用于一些有限品种代数的积极理论
作者:
Viorica Sofronie-Stokkermans
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
39.
A novel multiple-valued logic design using ballistic carbon nanotube FETs
机译:
一种使用弹道碳纳米管FET的新型多值逻辑设计
作者:
Raychowdhury A.
;
Roy K.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
nanotube devices;
carbon nanotubes;
ternary logic;
multivalued logic circuits;
ballistic transport;
SPICE;
logic design;
transient response;
multiple-valued logic design;
ballistic carbon nanotube FET;
geometry dependant threshold voltage;
ternary logic;
SPICE compatible model;
HSPICE;
dual-diameter CNFET;
functional blocks;
transient response;
C;
40.
Hard vs. Soft: The Central Question of Pre-Fabricated Silicon
机译:
硬与软:预先制造的硅的核心问题
作者:
Jonathan Rose
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
41.
A systolic parallel multiplier over GF(3/sup m/) using neuron-MOS DLC down-literal circuit
机译:
使用Neuron-MOS DLC Down-Linital电路通过GF(3 / SUP M /)的收缩期并联倍增器。
作者:
Byoung Hee Yoon
;
Sung Il Han
;
Young-Hee Choi
;
Jong-Hak Hwang
;
Hyeon-Kyeong Seong
;
Heung Soo Kim
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multiplying circuits;
Galois fields;
systolic arrays;
multivalued logic circuits;
adders;
CMOS logic circuits;
finite fields;
Galois fields;
systolic parallel multiplier;
GF(3/sup m/);
neuron-MOS down-literal circuit;
voltage mode DLC;
parallel input/output modulo multiplier;
AOTP multiplicative algorithm;
all one or two polynomials algorithm;
multiplier three-valued input;
multiplication gates;
addition gates;
CMOS technology;
0.35 micron;
3 V;
4 muW;
3 MHz;
42.
Ultra-Fine-Grain Field-Programmable VLSI Using Multiple-Valued Source-Coupled Logic
机译:
使用多值源耦合逻辑的超细晶粒现场可编程VLSI
作者:
Haque Mohammad Muniral
;
Michitaka Kameyama
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
43.
Non-deterministic matrices
机译:
非确定性矩阵
作者:
Avron A.
;
Lev I.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
matrix algebra;
multivalued logic;
decidability;
uncertainty handling;
propositional language;
many-valued semantics;
decidability;
generalized compactness theorem;
uncertainty reasoning;
nondeterminism;
nondeterministic matrices;
multiple-valued matrix;
finite Nmatrices;
truth value nondeterministic computations;
44.
Signed Digit CMOS (SD-CMOS) Logic Circuits with Static Operation
机译:
符号数字CMOS(SD-CMOS)逻辑电路,静态操作
作者:
Hideki Fukuda
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
45.
A Study of Multiple-Valued Magnetoresistive RAM (MRAM) Using Binary MTJ Devices
机译:
使用二元MTJ器件研究多值磁阻RAM(MRAM)
作者:
Hiromitsu Kimura
;
Kostas Pagiamtzis
;
Ali Sheikholeslami
;
Takahiro Hanyu
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
46.
Weakly associative functions on 0, 1 as logical connectives fuzzy logic
机译:
0,1的弱联交功能作为逻辑连接模糊逻辑
作者:
Kawaguchi M.F.
;
Miyakoshi M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
fuzzy logic;
Galois fields;
conjunctive operators;
weakly associative functions;
logical connectives;
weak associativity binary operators;
fuzzy logic syllogism;
Galois-operator right-residuals;
t-norm generators;
Galois-connections;
47.
Design and Verification of Parallel Multipliers Using Arithmetic Description Language: ARITH
机译:
使用算术描述语言的并行乘法器的设计和验证:ARITH
作者:
Kazuya Ishida
;
Naofumi Homnia
;
Takafumi Aoki
;
Tatsuo Higuchi
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
48.
Some Properties of Local Partial Clones on an Infinite Set
机译:
无限套装局部局部克隆的一些特性
作者:
B. A. Romov
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
49.
Minimal partial hyperclones on a two-element set
机译:
两个元素集上的最小部分超链器
作者:
Pantovic J.
;
Vojvodic G.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
algebra;
set theory;
algebraic theory;
partial hyperalgebras;
minimal partial hyperclones;
two-element set;
hyperclone lattice continuum cardinality;
minimal partial hyperoperations;
subset union;
50.
Spectra Generation for Fixed-Polarity Reed-Muller Transform over GF(5)
机译:
用于固定极性REED-MULLER转换的光谱生成GF(5)
作者:
Bogdan J. Falkowski
;
Cicilia C. Lozano
;
Susanto Rahardja
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
51.
A NOVEL D-LATCH IN MULTIPLE-VALUED SEMI-FLOATING-GATE RECHARGED LOGIC
机译:
多值半浮栅充电逻辑中的一种新型D-Latch
作者:
OMID MIRMOTAHARI
;
YNGVAR BERG
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
52.
Ternary Galois field expansions for reversible logic and Kronecker decision diagrams for ternary GFSOP minimization Galois field sum of products
机译:
Ternary Galois现场扩展用于Ternary GFSOP最小化的可逆逻辑和Kronecker决策图Galois Field Provest
作者:
Khan M.H.A.
;
Perkowski M.A.
;
Khan M.R.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
Galois fields;
decision diagrams;
ternary logic;
quantum gates;
Galois field sum of products;
Galois field decision diagrams;
ternary Galois field expansions;
multiple-valued logic;
reversible logic;
Kronecker decision diagrams;
ternary GFSOP minimization;
TGFSOP;
quantum logic design;
TGFE;
TGFDD flattening;
53.
Algebraic Properties of Totally Irreducible Elements of Clone Lattices
机译:
克隆格子完全不可缩续的元素的代数特性
作者:
Grant R. Pogosyan
;
Ivo G. Rosenberg
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
54.
A Single-Electron-Transistor Logic Gate Family and its Application - Part II: Design and Simulation of a 7-3 Parallel Counter with Linear Summation and Multiple-Valued Latch Functions
机译:
单电子晶体管逻辑栅极系列及其应用 - 第二部分:具有线性求和和多值锁存功能的7-3并联计数器的设计和仿真
作者:
Hiroshi Inokawa
;
Yasuo Takahashi
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
55.
Reduction of Sizes of Multi-Valued Decision Diagrams by Copy Properties
机译:
通过复制属性降低多价决策图的大小
作者:
Dragan Jankovic
;
Radomir S. Stankovic
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
56.
Polynomial Functions on a Central Relation
机译:
多项式核心关系
作者:
Dietmar Schweigert
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
57.
Optimizing the defuzzifier timing for the fuzzy control of a servodrive
机译:
优化Defuzzify对伺服驱动模糊控制的定时
作者:
Mihai D.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
servomechanisms;
fuzzy control;
optimisation;
microcontrollers;
interrupts;
drives;
defuzzifier timing optimization;
servodrive fuzzy control;
fuzzy logic controller;
fast electrical drive system;
low-cost microcontroller;
off-line conditioning;
on-line target processor resource management;
interrupt based algorithm;
motion resolution;
58.
Weakly Associative Functions on 0,1 as Logical Connectives
机译:
0,1上的弱联交功能作为逻辑连接
作者:
Mayuka F. Kawaguchi
;
Masaaki Miyakoshi
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
59.
A Method to Evaluate Logic Functions In the Presence of Unknown Inputs Using LUT Cascades
机译:
一种使用LUT级联在存在未知输入中的逻辑功能的方法
作者:
Yukihiro Iguchi
;
Tsutomu Sasao
;
Munehiro Matsuura
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
60.
On the Optimisation of Reed-Muller Expressions
机译:
关于Reed-Muller表达式的优化
作者:
K. J. Adams
;
J. McGregor
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
61.
Algorithms for Taylor Expansion Diagrams
机译:
泰勒展开图的算法
作者:
Gorschwin Fey
;
Rolf Drechsler
;
Maciej Ciesielski
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
62.
Polynomial functions on a central relation
机译:
多项式核心关系
作者:
Schweigert D.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
polynomials;
set theory;
clone induced binary central relations;
set theory;
central relation polynomial functions;
central polynomially complete algebra;
finite algebra;
set clones;
63.
A single-electron-transistor logic gate family and its application - Part I: basic components for binary, multiple-valued and mixed-mode logic
机译:
单电子晶体管逻辑门系列及其应用 - 第一部分:二进制,多值和混合模式逻辑的基本组件
作者:
Degawa K.
;
Aoki T.
;
Higuchi T.
;
Inokawa H.
;
Takahashi A.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic gates;
multivalued logic circuits;
logic circuits;
single electron transistors;
MOSFET circuits;
counting circuits;
digital arithmetic;
single-electron-transistor logic gate family;
binary logic circuits;
multiple-valued logic;
mixed-mode logic;
SET logic gates;
MOS transistors;
logic functions;
periodic transfer characteristics;
parallel counters;
carry-propagation-free arithmetic;
64.
On partial clones containing maximal clones
机译:
含有最大克隆的部分克隆
作者:
Haddad L.
;
Lau D.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
set theory;
maximal clone containing partial clones;
nonsingleton finite set;
prime affine;
h-universal relation;
continuum cardinality;
65.
Quantum Communication Complexity: A Survey
机译:
量子通信复杂性:调查
作者:
Gilles Brassard
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
66.
Ternary Galois field Expansions for Reversible Logic and Kronecker Decision Diagrams for Ternary GFSOP Minimization
机译:
用于Ternary GFSOP最小化的可逆逻辑和Kronecker决策图的三元伽罗米磁场扩展
作者:
Mozammel H. A. Khan
;
Marek A. Perkowski
;
Mujibur R. Khan
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
67.
Infra-Chip Address-Presetting Data-Transfer Scheme Using Four-Valued Encoding
机译:
使用四维编码的红外线地址预设数据传输方案
作者:
Akira Mochizuki
;
Takashi Takeuchi
;
Takahiro Hanyu
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
68.
Many Valued Probability Theory
机译:
许多有价值的概率理论
作者:
Charles G. Morgan
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
69.
A metasemantics to refine fuzzy if-then rules
机译:
一种优化模糊IF-DEL规则的代理方法
作者:
Claudio Moraga
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
70.
Some properties of local partial clones on an infinite set
机译:
无限套装局部局部克隆的一些特性
作者:
Romov B.A.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic;
set theory;
interpolation;
extrapolation;
maximal local partial clones;
infinite set;
infinite-valued logic functions;
interpolation;
extrapolation;
finite subset intersections;
full partial clone;
finite domain partial operation;
partial order extendibility conditions;
partial n-endomorphisms;
everywhere defined operation;
extendable clone;
71.
A Polynomial Time Algorithm for Non-Disjoint Decomposition of Multiple-Valued Functions
机译:
多项式时间算法,用于多值函数的非脱节分解
作者:
Elena Dubrova
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
72.
On universality of general reversible multiple-valued logic gates
机译:
关于一般可逆多价逻辑门的普遍性
作者:
Kerntopf P.
;
Perkowski M.A.
;
Khan M.H.A.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic gates;
multivalued logic circuits;
general reversible multiple-valued logic gate universality;
universal p-valued logic gates;
primitive logic gates;
logic functions;
universal single-gate libraries;
arbitrary input number circuits;
ternary gates;
73.
A Novel Multiple-Valued Logic Design Using Ballistic Carbon Nanotube FETs
机译:
一种使用弹道碳纳米管FET的新型多值逻辑设计
作者:
Arijit Raychowdhury
;
Kaushik Roy
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
74.
Multiple-input resonant-tunneling logic gates for flash A/D converter applications
机译:
用于闪光A / D转换器应用的多输入谐振隧道逻辑门
作者:
Tsuji Y.
;
Waho T.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
analogue-digital conversion;
threshold logic;
logic gates;
resonant tunnelling diodes;
high electron mobility transistors;
threshold logic circuit;
multiple-input logic gates;
resonant-tunneling logic gates;
flash A/D converters;
RT gates;
error-mode operation suppression;
MOBILE;
RTD/HEMT series connection;
4 bit;
8 bit;
16 bit;
75.
Multiple-valued source-coupled logic VLSI based on adaptive threshold control and its applications
机译:
基于自适应阈值控制及其应用的多值源耦合逻辑VLSI
作者:
Munirul H.M.
;
Kameyama M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
multivalued logic circuits;
threshold logic;
current-mode logic;
high-speed integrated circuits;
VLSI;
low-power electronics;
adders;
CMOS logic circuits;
multiple-valued source-coupled logic;
adaptive threshold voltage control;
current-mode integrated circuit;
ATVC;
high-speed VLSI;
low power VLSI;
fixed threshold voltage control;
input voltage shifting;
arithmetic circuits;
radix-2 signed-digit full adder;
SDFA;
CMOS;
0.18 micron;
76.
Multiple-valued multiple-rail encoding scheme for low-power asynchronous communication
机译:
低功耗异步通信的多值多轨编码方案
作者:
Takahashi T.
;
Hanyu T.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
encoding;
asynchronous circuits;
multivalued logic circuits;
low-power electronics;
VLSI;
multiple-valued multiple-rail encoding scheme;
asynchronous data transfer;
low-power asynchronous communication;
VLSI chip inter-module communication;
single wire dynamic range reduction;
power-delay products;
77.
A synthesis method for MVL reversible logic multiple value logic
机译:
MVL可逆逻辑的合成方法多价逻辑
作者:
Miller D.M.
;
Dueck G.W.
;
Maslov D.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
multivalued logic;
logic gates;
adders;
MVL reversible logic synthesis method;
logic function input/output mapping;
primitive reversible gate cascade;
bidirectional synthesis;
binary Toffoli gates;
m-variable r-valued reversible specifications;
adder;
78.
Basic multiple-valued functions using recharge CMOS logic
机译:
使用充值CMOS逻辑的基本多价函数
作者:
Berg Y.
;
Aunet S.
;
Noess O.
;
Mirmotahari O.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic circuits;
CMOS logic circuits;
low-power electronics;
multiple-valued functions;
recharge CMOS logic;
semi-floating-gate transistors;
SFG transistors;
low-power digital transition logic;
power dissipation reduction;
dynamic power dissipation;
MV logic;
mixed mode design;
79.
Reversible Fast Permutation Transforms for Quantum Circuit Synthesis
机译:
可逆快速排列变换为量子电路合成
作者:
Anas N. Al-Rabadi
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
80.
A Synthesis Method for MVL Reversible Logic
机译:
MVL可逆逻辑的合成方法
作者:
D. Michael Miller
;
Gerhard W. Dueck
;
Dmitri Maslov
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
81.
Reversible fast permutation transforms for quantum circuit synthesis
机译:
可逆快速排列变换为量子电路合成
作者:
Al-Rabadi A.N.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
low-power electronics;
Galois fields;
quantum gates;
multivalued logic;
reversible butterfly circuits;
Galois fields;
reversible fast permutation transforms;
quantum circuit synthesis;
multiple-valued quantum circuits;
power consumption reduction;
quantum computing;
reversibility;
quantum circuits;
82.
A polynomial time algorithm for non-disjoint decomposition of multiple-valued functions
机译:
多项式时间算法,用于多值函数的非脱节分解
作者:
Dubrova E.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
multivalued logic circuits;
polynomials;
polynomial time algorithm;
multiple-valued function nondisjoint decomposition;
logic circuit multiple-vertex dominators;
83.
A metasemantics to refine fuzzy if-then rules
机译:
一种优化模糊IF-DEL规则的代理方法
作者:
Moraga C.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
fuzzy set theory;
fuzzy logic;
piecewise linear techniques;
semantic networks;
computational linguistics;
splines (mathematics);
fuzzy modelling;
piecewise linear fuzzy sets;
fuzzy if-then rule refinement;
metasemantic modifiers;
fuzzy model tuning;
linguistic variables terms;
rule interpretability;
multiresolution;
discourse universe;
triangular shaped linguistic terms;
symmetric triangles;
first degree splines;
84.
MULTIPLE-INPUT RESONANT-TUNNELING LOGIC GATES FOR FLASH A/D CONVERTER APPLICATIONS
机译:
用于闪光A / D转换器应用的多输入谐振隧道逻辑门
作者:
Yuki Tsuji
;
Takao Waho
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
85.
Automata over MV-algebras many-valued logic
机译:
MV-Algebras的自动机许多值逻辑
作者:
Gerla B.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
automata theory;
multivalued logic;
fuzzy logic;
algebra;
formal languages;
fuzzy automata;
Lukasiewicz many-valued logic;
W-algebras;
semiring reducts;
supremum operation;
Lukasiewicz conjunction;
infimum operation;
Lukasiewicz disjunction;
isomorphism;
many-valued automata;
many-valued formal languages;
86.
A self-restored current-mode CMOS multiple-valued logic design technique and its applications
机译:
一种自恢复的当前模式CMOS多价逻辑设计技术及其应用
作者:
Teng D.H.Y.
;
Bolton R.J.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
current-mode logic;
CMOS logic circuits;
majority logic;
self-restored current-mode CMOS;
CMOS multiple-valued logic;
CMCL area requirements;
majority circuit;
tally circuit;
87.
Edge-Valued Decision Diagrams for Multiple-Valued Functions
机译:
用于多值函数的边缘值决策图
作者:
Radomir S. Stankovic
;
Jaakko Astola
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
88.
Three dimensional multiple valued circuits design based on single-electron logic
机译:
基于单电子逻辑的三维多值电路设计
作者:
Yanushkevich S.N.
;
Shmerko V.P.
;
Guy L.
;
Lu D.C.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
multivalued logic circuits;
decision diagrams;
decision trees;
hypercube networks;
single electron transistors;
network topology;
multiple-valued decision diagram techniques;
decision trees;
N-hypercube interconnection network;
nanoelectronic devices;
3D multiple valued circuits;
SET logic;
hypercube-like topology;
single-electron transistor technology;
graph embedding technique;
hypercube based structures;
multiple-valued networks;
89.
The Interface between P and NP in Signed CNF Formulas
机译:
符号CNF公式中P和NP之间的界面
作者:
C. Ansotegui
;
R. Bejar
;
A. Cabiscol
;
F. Manya
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
90.
Signed digit CMOS (SD-CMOS) logic circuits with static operation
机译:
符号数字CMOS(SD-CMOS)逻辑电路,静态操作
作者:
Fukuda H.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic circuits;
CMOS logic circuits;
adders;
driver circuits;
logic gates;
flip-flops;
full adder;
static operation logic circuits;
signed digit CMOS logic circuits;
SD-CMOS;
voltage-mode logic circuits;
multivoltage power supply;
driver circuit;
inverter circuit;
D-flip-flop;
91.
Design of Quaternary Logic gate Using Double Pass-transistor Logic with neuron MOS: Down Literal Circuit
机译:
用神经元MOS双通晶体管逻辑设计四季逻辑门:下对文字电路
作者:
Soo Jin Park
;
Byoung Hee Yoon
;
Kwang Sub Yoon
;
Heung Soo Kim
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
92.
Minimal Partial Hyperclones on a Two-element Set
机译:
两个元素集上的最小部分超链器
作者:
Jovanka Pantovic
;
Gradimir Vojvodic
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
93.
Controlling uncertainty in discretization of continuous data
机译:
控制连续数据的离散化的不确定性
作者:
Popel D.V.
;
Popel E.I.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
knowledge representation;
quantisation (signal);
uncertainty handling;
multivalued logic;
data mining;
decision diagrams;
information theory;
quantization;
adaptive discretization algorithm;
information density;
discretization uncertainty control;
continuous data discretization;
multiple-valued/continuous signal dependencies;
circuit design;
knowledge discovery;
continuous data optimal representation;
information measures;
analog/discrete data processing;
interval decision diagrams;
multiple-valued decision diagrams;
information theory;
knowledge representation;
multiple-valued logic;
94.
On the minimization of multiple-valued input binary-valued output functions logic synthesis
机译:
关于多值输入二进制值输出功能的最小化逻辑合成
作者:
Babu H.M.H.
;
Zaber M.I.
;
Islam M.R.
;
Rahman M.M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
minimisation;
multivalued logic circuits;
Boolean functions;
logic synthesis;
multiple-valued function minimization;
multiple-valued input binary-valued output functions;
MVITVO;
ON set base minterms;
enhanced assignment graph;
Boolean variables grouping;
prime implicant;
logic minimization;
potential canonical cube;
essential primes;
sum of products;
SOP;
95.
On Partial Clones containing Maximal Clones
机译:
含有最大克隆的部分克隆
作者:
Lucien Haddad
;
Dietlinde Lau
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
96.
A graph-theoretical approach to Boolean interpolation of non-Boolean functions
机译:
非布尔函数布尔插值的图形理论方法
作者:
Rudeanu S.
;
Simovici D.A.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
Boolean algebra;
graph theory;
interpolation;
function approximation;
nonBoolean function Boolean interpolation;
graph-theoretical methods;
nonBoolean function approximation;
Boolean algebra;
graph minimal chromatic decompositions;
graph vertices;
Boolean functions;
97.
Algorithms for Taylor expansion diagrams IC design/verification applications
机译:
泰勒展开图的算法IC设计/验证应用
作者:
Fey G.
;
Drechsler R.
;
Ciesielski M.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
directed graphs;
Boolean functions;
logic design;
computational complexity;
Boolean functions;
directed acyclic graph;
Taylor expansion diagram algorithms;
IC size problems;
IC synthesis;
IC verification;
TED data structure;
high level information;
function representation;
TED operations complexity;
TED optimization;
98.
A single-electron-transistor logic gate family and its application - Part II: design and simulation of a 7-3 parallel counter with linear summation and multiple-valued latch functions
机译:
单电子晶体管逻辑栅极系列及其应用 - 第二部分:具有线性求和和多值锁存功能的7-3并联计数器的设计和仿真
作者:
Inokawa H.
;
Takahashi Y.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
low-power electronics;
counting circuits;
multivalued logic circuits;
adders;
flip-flops;
single electron transistors;
logic gates;
multiple-valued logic;
SET logic gate family;
single-electron-transistor logic;
parallel counter;
linear summation function;
multiple-valued latch function;
latched multiple-valued quantizer;
MIMO counter;
inverting adder;
periodic literals;
ultra-low power consumption;
1.0 muW;
100 MHz;
99.
Many valued probability theory
机译:
许多有价值的概率理论
作者:
Morgan C.G.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
multivalued logic;
probability;
semantic networks;
semantically compositional logic;
many valued probability theory;
many valued logic;
sentence specified truth value probability;
finite valued logics;
semantic range subset;
probabilistic semantics;
100.
Quantum circuit synthesis using classes of GF(3) reversible fast spectral transforms
机译:
使用GF(3)类可逆快频变换量的量子电路合成
作者:
Al-Rabadi A.N.
会议名称:
《International Symposium on Multiple-Valued Logic》
|
2004年
关键词:
logic design;
quantum gates;
multiplying circuits;
adders;
Galois fields;
low-power electronics;
GF(3) reversible fast spectral transforms;
quantum circuit synthesis;
reversible Davio expansions;
reversible butterfly circuit plane;
quantum gates plane;
addition circuits;
multiplication circuits;
power consumption reduction;
reversibility;
意见反馈
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