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IEEE International Symposium on Multiple-Valued Logic
IEEE International Symposium on Multiple-Valued Logic
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1.
Implementation of multiple-output functions using PQMDDs
机译:
None
作者:
Iguchi Y.
;
Sasao T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
2.
Computation of spectral information from logic netlists
机译:
None
作者:
Drechsler R.
;
Thornton M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
3.
Rigidity problem of autodual clones
机译:
None
作者:
Miyakawa M.
;
Rosenberg I.G.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
4.
Integration of information in four-valued logics under non-uniform assumptions
机译:
在非统一假设下的四维逻辑中的信息集成
作者:
Loyer Y.
;
Spyratos N.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
5.
Cost-analysis of 4-valued unary functions implemented using current-mode CMOS circuits
机译:
使用电流模式CMOS电路实现的4值机构的成本分析
作者:
Abd-El-Barr M.
;
Al-Mutawa A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
6.
The synthesis of multiple-valued logic circuits using local-excitation-type neuron models
机译:
用局部激励型神经元模型合成多值逻辑电路
作者:
Matsumoto M.
;
Ueda Y.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
7.
On algebraic foundations of information granulation III. Investigating the HATA-MUKAIDONO approach
机译:
关于信息造粒的代数基础III。调查Hata-Mukaidono方法
作者:
Thiele H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
8.
Fuzzy decision diagrams for the representation, analysis and optimization of rule bases
机译:
规则基础表示,分析和优化的模糊决策图
作者:
Strehl K.
;
Moraga C.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
9.
Standard CMOS implementation of a multiple-valued logic signed-digit adder based on negative differential-resistance devices
机译:
基于负差分电阻器件的多值逻辑签名数字加法器的标准CMOS实现
作者:
Gonzalez A.F.
;
Bhattacharya M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
10.
A method for approximate equivalence checking
机译:
一种近似等价检查的方法
作者:
Thornton M.
;
Drechsler R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
11.
Novel resonant-tunneling multiple-threshold logic circuit based on switching sequence detection
机译:
基于开关序列检测的新型谐振隧道多阈值逻辑电路
作者:
Waho T.
;
Hattori K.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
12.
Evolutionary multi-level network synthesis in given design style
机译:
鉴于设计风格的进化多级网络合成
作者:
Luba T.
;
Moraga C.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
13.
An efficient data transmission technique for VLSI systems based on multiple-valued code-division multiple access
机译:
基于多值码分割多址的VLSI系统有效数据传输技术
作者:
Yuminaka Y.
;
Katoh O.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
14.
Some properties of discrete interval truth valued logic
机译:
离散间隔真理有价值逻辑的一些属性
作者:
Takagi N.
;
Nakashima K.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
15.
Demonstration of a novel multiple-valued T-gate using multiple-junction surface tunnel transistors and its application to three-valued data flip-flop
机译:
使用多结表面隧道晶体管的新型多值T型栅极的演示及其在三值数据触发器上的应用
作者:
Uemura T.
;
Baba T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
16.
Neural networks: binary monotonic and multiple-valued
机译:
神经网络:二元单调和多重值
作者:
Zurada J.M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
17.
The computing capacity of three-input multiple-valued one-threshold perceptrons
机译:
三输入多值单阈值的计算能力的计算能力
作者:
Ngom A.
;
Stojmenovic I.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
18.
Structures with many-valued information and their relational proof theory
机译:
具有多价信息及其关系证明理论的结构
作者:
Duntsch I.
;
MacCaull W.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
19.
Experiments on FPRM expressions for partially symmetric logic functions
机译:
部分对称逻辑函数表达式的实验
作者:
Yanushkevich S.N.
;
Butler J.T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
20.
Chaining techniques for automated theorem proving in many-valued logics
机译:
多价逻辑中证明自动定理的链接技术
作者:
Ganzinger H.
;
Sofronie-Stokkermans V.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
21.
Probabilistic verification of multiple-valued functions
机译:
多价函数的概率验证
作者:
Dubrova E.
;
Sack H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
22.
Fast transforms for multiple-valued input binary output PLI logic
机译:
用于多值输入二进制输出PLI逻辑的快速变换
作者:
Falkowski B.J.
;
Rahardja S.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
23.
A multilevel-cell 32 Mb flash memory
机译:
多级单元32 MB闪存
作者:
Bauer M.
;
Alexis R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
24.
Information theoretic approach to minimization of polynomial expressions over GF(4)
机译:
GF(4)中多项式表达最小化的信息理论方法
作者:
Yanushkevich S.
;
Popel D.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
25.
Multi-input variable-threshold circuits for multi-valued logic functions
机译:
多值逻辑功能的多输入可变阈值电路
作者:
Syuto M.
;
Shen J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
26.
Silicon single-electron devices and their applications
机译:
硅单电子器件及其应用
作者:
Takahashi Y.
;
Fujiwara A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
27.
Mod-p decision diagrams: a data structure for multiple-valued functions
机译:
Mod-P判定图:多值函数的数据结构
作者:
Sack H.
;
Dubrova E.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
28.
Low-power dual-rail multiple-valued current-mode logic circuit using multiple input-signal levels
机译:
低功耗双轨多值电流模式逻辑电路,使用多输入信号电平
作者:
Hanyu T.
;
Ike T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
29.
Representations of multiple-output switching functions using multiple-valued pseudo-Kronecker decision diagrams
机译:
使用多元值伪克朗克策略图的多输出切换功能的表示
作者:
Hasan Babu H.M.
;
Sasao T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
30.
Novel /spl Pi/-type resistor network in D/A converter based on multiple-valued logic
机译:
基于多值逻辑的D / A转换器中的新型/ SPL PI / -TYPE电阻网络
作者:
Xunwei Wu
;
Xuanchang Zhou
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
31.
A four-valued logic B(4) of E(9) for modeling human communication
机译:
E(9)的四价逻辑B(4),用于建模人类沟通
作者:
Rine D.
;
Alnakari R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
32.
Lower bound sifting for MDDs
机译:
用于MDD的下限筛分
作者:
Jankovic D.
;
Gunther W.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
33.
Logic synthesis of controllers for B-ternary asynchronous systems
机译:
B-Ternary异步系统控制器的逻辑合成
作者:
Nagata Y.
;
Miller D.M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
34.
Properties of independent components of self-motion optical flow
机译:
自动运动光流的独立组件的性质
作者:
Jabri M.A.
;
Ki-Young Park
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
35.
Propagation algorithm of behavior probability in power estimation based on multiple-valued logic
机译:
基于多值逻辑功率估计的行为概率传播算法
作者:
Xunwei Wu
;
Pedram M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
36.
Hardware implementation of 'Supplementary symmetrical logic circuit structure' concepts
机译:
“补充对称逻辑电路结构”概念的硬件实现
作者:
Olson D.
;
Current K.W.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
37.
On Urquhart's C logic
机译:
在Urquhart的C逻辑上
作者:
Ciabattoni A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
38.
Dynamic re-encoding during MDD minimization
机译:
MDD最小化期间的动态重新编码
作者:
Schmiedle F.
;
Gunther W.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
39.
Multi-valued logic pass gate network using neuron-MOS transistors
机译:
使用Neuron-MOS晶体管的多值逻辑传输门网络
作者:
Shen J.
;
Inaba M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
40.
Fault analysis of the multiple valued logic using spectral method
机译:
使用光谱法对多值逻辑的故障分析
作者:
Kim J.O.
;
Lala P.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
41.
Implementation of multiple-valued multiplier on GF(3/sup m/) using current mode CMOS
机译:
使用电流模式CMOS在GF(3 / SUP M /)上实现多值乘法器
作者:
Hyeon Kyeong Seong
;
Jai Seok Choi
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
42.
Multi-valued sub-function encoding in functional decomposition based on information relationships measures
机译:
基于信息关系措施的功能分解中的多值子函数编码
作者:
Chojnacki A.
;
Jozwiak L.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
43.
Computational neurobiology meets semiconductor engineering
机译:
计算神经生物学符合半导体工程
作者:
Hammerstrom D.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
44.
The 2-SAT problem of regular signed CNF formulas
机译:
常规签署的CNF公式的2-SAT问题
作者:
Beckert B.
;
Hahnle R.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
45.
MDD-based synthesis of multi-valued logic networks
机译:
基于MDD的多价逻辑网络合成
作者:
Drechsler R.
;
Thornton M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
46.
A new class of fuzzy modifiers
机译:
一类新的模糊改造者
作者:
De Cock M.
;
Kerre E.E.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
47.
On the number of dependent variables for incompletely specified multiple-valued functions
机译:
关于不完全指定的多价函数的依赖变量的数量
作者:
Sasao T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
48.
A new algorithm to compute quaternary Reed-Muller expansions
机译:
一种计算四季簧片汇聚器扩展的新算法
作者:
Rahardja S.
;
Falkowski B.J.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
49.
High-radix parallel VLSI dividers without using quotient digit selection tables
机译:
高基点并行VLSI分频器而不使用商点选择表
作者:
Aoki T.
;
Nakazawa K.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
50.
Gray scale image compression based on multiple-valued input binary functions, Walsh and Reed-Muller spectra
机译:
基于多元值输入二进制功能,沃尔什和芦苇Muller光谱的灰度尺度图像压缩
作者:
Falkowski B.J.
;
Lip-San Lim
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
51.
Evolvable hardware: from on-chip circuit synthesis to evolvable space systems
机译:
不断变化的硬件:从片上电路合成到可进化的空间系统
作者:
Stoica A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
52.
Controllability/observability measures for multiple-valued test generation based on D-algorithm
机译:
基于D算法的多价试验生成可控性/可观测性措施
作者:
Kamiura N.
;
Hata Y.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
53.
Independence of the axioms of Boolean algebra in multiple-valued logic
机译:
多价逻辑中布尔代数的公理的独立性
作者:
Ninomiya T.
;
Mukaidono M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
54.
de Morgan bisemilattices
机译:
的Morgan比semi lattice算
作者:
Brzozowski J.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
55.
A study on the ternary parallel circuit design with DCG properties based on the matrix equation
机译:
基于矩阵方程的DCG特性三元平行电路设计研究
作者:
Gi-Noung Byun
;
Chol-U Lee
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
56.
Fibonacci decision diagrams and spectral Fibonacci decision diagrams
机译:
Fibonacci决策图和光谱斐波纳契决策图
作者:
Stankovic R.S.
;
Stankovic M.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
57.
Finite-valued approximations of product logic
机译:
有限值的产品逻辑近似值
作者:
Aguzzoli S.
;
Gerla B.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
58.
An evolutionary computing approach to multilevel logic synthesis using various logic operations
机译:
使用各种逻辑操作的多级逻辑合成的进化计算方法
作者:
Hozumi T.
;
Kakusho O.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
59.
DRAM-cell-based multiple-valued logic-in-memory VLSI with charge addition and charge storage
机译:
基于DRAM-CELL的多值逻辑内存VLSI,充电添加和充电存储
作者:
Hanyu T.
;
Kimura H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
60.
Design of a quaternary latch circuit using a binary CMOS RS latch
机译:
使用二进制CMOS RS锁存器设计四季锁存电路
作者:
Current K.W.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
|
2000年
61.
On the intersection of maximal partial clones and the join of minimal partial clones
机译:
关于最大局部克隆的交点和最小局部克隆的连接
作者:
Haddad L.
;
Machida H.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
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2000年
62.
Arithmetic-oriented multiple-valued logic-in-memory VLSI based on current-mode logic
机译:
基于当前模式逻辑的算术型多值逻辑内存VLSI
作者:
Kaeriyama S.
;
Hanyu T.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
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2000年
63.
Data mining of weak functional decompositions
机译:
弱功能分解的数据挖掘
作者:
Jaroszewicz S.
;
Simovici D.A.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
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2000年
64.
Author Index
机译:
作者索引
作者:
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
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2000年
65.
On an architecture of medical image registration system based on multiple-valued logic
机译:
基于多价逻辑的医学图像登记系统架构
作者:
Hata Y.
;
Kobashi S.
;
Institute of Electric and Electronic Engineer
会议名称:
《IEEE International Symposium on Multiple-Valued Logic》
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2000年
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