机译:混合RF /金属时钟路由在超大型电路中改进的时延和过程变化容错时钟树网络
Electrical and Computer Engineering Department, Shahid Beheshti University, G. C., Tehran 19839-63113, Iran;
Electrical and Computer Engineering Department, Shahid Beheshti University, G. C., Tehran 19839-63113, Iran;
Clock distribution network; RF interconnect; process variation;
机译:半同步电路的延迟变化容忍时钟调度
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机译:混合RF /金属时钟路由算法可改善时钟延迟和路由拥塞
机译:时钟逻辑自动映射到准延迟不敏感电路。
机译:严格建模自稳定的容错电路:片上系统的超鲁棒时钟方案
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