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【24h】

Sorting Stacked-die The Challenges of Building SiPs

机译:堆叠芯片排序对构建SiP的挑战

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摘要

Designing an interconnect plan for a stack of die is a complex process. The key to building cost-effective stacked-die SiPs and ensuring high reliability will be the availability of comprehensive new design capabilities that optimize and accelerate the package design process by automating wirebonding and integrating physical and electrical constraints into a single, seamless design flow.
机译:为管芯堆叠设计互连计划是一个复杂的过程。构建具有成本效益的堆叠式芯片SiP并确保高可靠性的关键在于,提供全面的新设计功能,这些功能可通过自动化引线键合并将物理和电气约束集成到一个无缝的设计流程中来优化和加速封装设计过程。

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