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基于FPGA的通用RS编解码器的VHDL设计方法

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摘要

利用VHDL中的枚举和函数重载功能定义伽罗华域中的各种"+","-","×","÷"运算,并且自定义了BCH解码中用到的函数和数据结构,使得编写的程序更加接近理论上对RS码的描述,从而增加可读性,并且在程序调试时减少了工作量,提高了效率.仿真结果表明该方法具有容易实现的特点.

著录项

来源
《电视技术》 |2004年第3期|16-20|共5页
作者
梁炜新; 王群生; 牟刚;
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作者单位

华南理工大学,电子与信息学院,广东,广州,510641;

华南理工大学,电子与信息学院,广东,广州,510641;

华南理工大学,电子与信息学院,广东,广州,510641;

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原文格式 PDF
正文语种 chi
中图分类图像通信、多媒体通信;
关键词
Reed-Solomon编解码; 超高速集成电路硬件描述语言; 伽罗华域; 函数重载;

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