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喻希;
同济大学,通信软件及专用集成电路设计中心,上海,200092;
卷积码; Viterbi解码器; 寄存器传输级; 数字通信系统;
机译:不带加法器结构的低功耗空时网格编码的Viterbi解码器设计,采用RTL模型
机译:Turbo TCM解码器的工作级设计流水线处理电路的自动综合及与RTL设计的比较
机译:RTL设计和VLSI高效卷积编码器和Adaptive Viterbi解码器的实现
机译:用于无线通信的低功耗异步Viterbi解码器的设计。
机译:基于BMI系统中退地平线优化的自适应解码器设计
机译:“Viterbi解码器及其硬件特洛伊木马型号”中排名第2:基于FPGA的实施研究(V0.1)“
机译:用于Reed-muller子码的高速Viterbi解码器的架构和实现考虑因素
机译:Viterbi存储器ACS最佳结构的解码器(Viterbi解码器中ACS的存储器的最佳结构)
机译:优化Viterbi解码器和GNSS接收器
机译:优化的Viterbi解码器和GNSS接收器
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