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李施豪; 应三丛;
四川大学计算机学院视觉合成图形图像技术国家重点学科实验室;
卷积神经网络; 激励函数; FPGA; 多项式逼近;
机译:基于RISC架构的基于32位FPGA的单精度浮点混合CORDIC处理器
机译:基于浮点FPGA的STAP应用QRD-MGS算法的高速实现
机译:具有块浮点算法的基于FPGA的高性能CNN加速器
机译:基于FPGA的低延迟浮点指数函数实现
机译:含咖啡因的FPGA:用于训练和推理卷积神经网络的FPGA框架,具有降低的精度浮点算法
机译:基于模型的设计浮点累加器。研究案例:支持向量机内核功能的FPGA实现
机译:基于Gauss-Jordan算法的浮点表示的FpGa参数化矩阵反演库的FpGa实现
机译:FpGa上基于浮点的应用的面积和功耗性能分析
机译:基于FPGA的高速低延迟浮点累加器及其实现方法
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