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基于FPGA的JPEG2000自适应算术编码器设计

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文中研究JPEG2000标准中自适应算术编码器的硬件实现问题,采用并行结构的FPGA设计,并用Modelsimse5.8对其作仿真验证.设计使用VerilogHDL语言在RTL级描述,并以Xilinx VertexII系列中的xc2v250-6fg256器件为基础在ISE6.1下完成综合.

著录项

来源
《计算机技术与发展》 |2006年第10期|211-213216|共4页
作者
陈玮; 杨名利;
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作者单位

西南交通大学;

信息科学与技术学院;

四川;

成都;

610031;

西南交通大学;

信息科学与技术学院;

四川;

成都;

610031;

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原文格式 PDF
正文语种 chi
中图分类图像编码;
关键词
JPEG2000; 算术编码器; FPGA; 图像压缩;

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