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目录
引言
1绪论
1.1高速低功耗集成电路的研究背景
1.2传统CMOS电路的功耗分析
1.3双轨电流模逻辑电路静态功耗抑制技术研究的重要性及论文的主要工作
2传统静态CMOS逻辑电路功耗减小技术
2.1传统CMOS静态功耗抑制技术
2.1传统CMOS动态功耗抑制技术
2.3传统静态CMOS逻辑电路功耗减小技术的应用
2.4本章小结
3双轨电流模逻辑电路
3.1双轨电流模逻辑电路简介
3.2双轨电流模逻辑反相器/缓冲器
3.3双轨电流模逻辑单元设计方法
3.4本章小结
4双轨电流模逻辑门电路的优化
4.1优化目标及其技术难点
4.2仿真方法
4.3电路限制和性能标准
4.4设计参数
4.5 MCML门电路优化过程
4.6本章小结
5双轨电流模逻辑功控电路
5.1控制上拉电阻网络法
5.2控制独立电流源法
5.3双高阈值管控制法
5.4本章小结
6近阈值高速MCML电路的研究
6.1近阈值高速电流模组合电路
6.2近阈值高速电流模时序电路
6.3十进制计数器的版图后仿真
6.4本章小结
7结论
参考文献
致谢
宁波大学;