multiplying circuits; FPGA application; VLSI application; array multiplier; signed number computations; unsigned numbers;
机译:高效Baugh-Wooley乘法器的基本构件的设计和现场可编程门阵列实现|科学出版物
机译:改进的BAUGH-WOOLEY算法和体系结构对TWOS互补阵列乘法器的16位实现
机译:使用CslA加法器和全速GDI逻辑的层次结构数组乘法器的改进实现
机译:使用Vedic乘法器,阵列乘法器和组合整数和浮点倍增器(CIFM)实现32位复合点乘法器的实现
机译:功能分解有限域乘法器,以在现场可编程门阵列上高效实现。
机译:速度能量和面积优化的早期输出准延迟不敏感阵列乘法器
机译:高效Baugh-Wooley乘法器的基本构件的设计和现场可编程门阵列实现