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肖立伊;
中国计算机学会CAD与图形专业委员会;
逻辑设计;
机译:从UML-MARTE到VHDL的NoC设计的系统级建模方法
机译:用于行为综合的VHDL的源代码级优化
机译:内置自测(BIST)的VHDL建模,用于系统级芯片(SOC)设计
机译:使用VHDL-AMS对光电设备和系统进行电路级建模和仿真。
机译:津巴布韦马尼卡兰德省一家三级医疗机构的高血压门诊患者的药物依从行为2011年
机译:对VHDL的系统级行为和结构建模扩展的注意事项
机译:VHDL综合环境中的行为故障建模
机译:使用VHDL进行客户端/服务器行为建模和测试用例开发,以改进逻辑验证
机译:通过预处理将VHDL多个等待行为FSM合成为RT级FSM
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